ragnar/FPGA_Config
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Sync with Fredi's source tree 15/04/2017

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David Gálvez
2018-04-09 17:21:35 +02:00
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commit b2d17efff1
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FPGA_by_Fredi/firebee1.pin
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@@ -490,7 +490,7 @@ VDM[2] : U20 : output : 2.5 V :
VD[7] : U21 : bidir : 2.5 V : : 5 : Y
VDQS[2] : U22 : bidir : 2.5 V : : 5 : Y
nPD_VGA : V1 : output : 3.3-V LVTTL : : 2 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : V2 : : : : 2 :
nDREQ0 : V2 : output : 3.3-V LVTTL : : 2 : Y
nPCI_INTC : V3 : input : 3.3-V LVTTL : : 2 : Y
nPCI_INTB : V4 : input : 3.3-V LVTTL : : 2 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : V5 : : : : 3 :